Luận văn Thiết kế và thi công mạch cộng vi dải băng tần wifi

chất rất quan trọng để ta chọn mạch làm thành phần của bộ cộng. Chú ý rằng ma trận [S] ko mâu thuẫn với phần lý thuyết ở trên (các hệ số âm) khi đề cập đến phần lý thuyết tổng quát của mạch 4 cửa, vì thực chất chúng chỉ khác nhau do ta chọn điểm gốc pha của tín hiệu tại cửa vào là khác nhau. 3.3 Phân tích mạch ghép hỗn hợp (hybrid) : Ma trận [S] ở trên có thể đƣợc kiểm chứng bằng cách phân tích thành mode chẵn và mode lẻ của tín hiệu đặt vào mạch ghép hỗn hợp (hybrid) . Thật vậy, giả sử ta đặt tín hiệu vào cửa 1, tại cửa 2, 3 và 4 là các điện trở chuẩn phối hợp trở kháng .   0 1 0 0 0 11 1 0 02 0 1 0 j j S j j              Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 17 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Ta có thể vẽ lại cấu trúc mạch sau khi đã chuẩn hoá các điện trở tải theo . Tín hiệu vào tại cửa 1 là trong khi tín hiệu ra tại các cửa lần lƣợt là , , và nhƣ hình sau: Hình 3.4 Chúng ta sẽ lần lƣợt phân tích tín hiệu ở hình 3.4 thành mode chẵn và mode lẻ. Hệ thống mode chẵn: Hình 3.5a Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 18 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 3.5b Với mode chẵn, ta coi rằng có hai tín hiệu đồng pha cùng đặt vào cửa 1 và cửa 4. Do tính chất đối xứng của cấu trúc, có thể coi nhƣ có một mặt phân cách đối xứng (đƣờng chấm chấm ở hình 3.5a), mà tại đó, dòng điện triệt tiêu tƣơng đƣơng điểm hở mạch. Kết quả, ta có thể tách mạch ghép hỗn hợp ở mode chẵn thành hai phần riêng biệt chứa các stub đầu cuối hở mạch, nhƣ trình bày ở hình 3.5b Hình 3.6 Xét riêng từng đoạn, ta coi nhƣ mạch điện ở mỗi phần gồm 3 mạng 2 cửa ghép liên tiếp nhau (hình 3.6). Hai mạng đầu và cuối là của stub đầu cuối hở mạch, có ma trận [ ] là: Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 19 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM [ ] [ ] (3.15) Tƣơng tự, mạng 2 cửa ở giữa là một đƣờng truyền sóng đơn chiều dài , điện trở đặc tính (đã chuẩn hoá) √ , có ma trận [ ] là: [ ] 0 √ √ 1 (3.16) Kết quả, ma trận [ ] của mode chẵn đƣợc suy ra từ việc ghép liên tiếp 3 mạng 2 cửa (nhƣ ở hình 3.6): [ ] [ ] [ ] [ ] [ ] 0 √ √ 1 [ ] √ [ ] (3.17) Dùng công thức chuyển đổi từ [ABCD] sang [S], với các đại lƣợng đã chuẩn hoá theo , ta tính đƣợc: Hệ số phản xạ tại cửa 1 cho mode chẵn: √ √ (3.18a) Hệ số truyền từ cửa 1 sang cửa 2 cho mode chẵn: √ √ (3.18b) Hệ thống mode lẻ: Với mode lẻ, ta xem rằng có hai tín hiệu ngƣợc pha /2 và /2 lần lƣợt đặt vào cửa 1 và cửa 4. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 20 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Lúc này, ta coi nhƣ hai phần của mạch ghép hỗn hợp phân cách nhau bởi một mặt phản đối xứng, tại đó điện thế tín hiệu là triệt tiêu (nối đất về điện thế), nhƣ đƣợc trình bày ở hình 3.7a. Ta có thể tách mạch ghép hỗn hợp ở mode lẻ thành hai phần riêng biệt chứa các stub đầu cuối nối đất, nhƣ đƣợc vẽ ở hình 3.7b. Hình 3.7a Hình 3.7b Phân tích mỗi phần thành ba mạng hai cửa ghép liên tiếp nhau. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 21 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 3.8 Hoàn toàn tƣơng tự nhƣ đối với mode chẵn, ta tính đƣợc [ ] có dạng: [ ] √ [ ] (3.19) Tƣơng tự, ta cũng suy ra: Hệ số phản xạ tại cửa 1 cho mode lẻ: (3.20a) Hệ số truyền đạt từ cửa 1 sang cửa 2 cho mde lẻ: √ (3.20b) Vậy, sóng ra tại các cửa là tổng của sóng ra mode chẵn và mode lẻ, ta thu đƣợc: (3.21a) √ (3.21b) √ (3.21c) (3.21d) Các biểu thức (3.21) cho phép a suy ra ma trận [S] của mạch ghép hỗn hợp   0 1 0 0 0 11 1 0 02 0 1 0 j j S j j              Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 22 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM 3.4 Ƣu khuyết điểm của mạch:  Ƣu điểm: - Thực hiện việc chia đôi công suất vào cửa 1 tốt. - Có khối lƣợng và bề dày mỏng. - Dễ dàng sản xuất hàng loạt.  Khuyết điểm: - Kích thƣớc còn lớn nếu ở tần số cao, nên khó tích hợp vào những thiết bị yêu cầu kích thƣớc nhỏ gọn. - Tính chịu nhiệt độ không cao. - Không thể làm việc đƣợc ở mức công suất cao. - Băng thông khá hẹp. Ứng dụng thực tế:  Đƣợc sử dụng trong cả những ứng dụng thƣơng mại và quân đội.  Công dụng cơ bản của mạch là chia công suất từ đầu vào đến 2 ngõ ra.  Sử dụng trong những thiết kế cần dịch pha nhƣ điều chế tín hiệu.  Có thể sử dụng trên băng tần C, chia công suất cũng nhƣ bộ ghép công suất. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 23 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM 3.5 Phân tích đáp ứng của mạch: Xét mạch ghép hỗn hợp có ma trận tán xạ [S] nhƣ sau: Xét tín hiệu đặt vào cửa 1 là trong khi tín hiệu ra tại các cửa lần lƣợt là , , và . Giả sử . Ta cần tính , , và Hình 3.9 Ta có quan hệ [a] = [S].[b] (3.22a) √ (3.22b) √ (3.22c) (3.22d) Khi đƣa tín hiệu vào cửa 1, tín hiệu ra tại cửa 2 và cửa 3 có biên độ bằng nhau và lệch pha (cửa 2 là và cửa 3 là , cửa 1 là ). Gọi J là hiệu số pha giữa cửa 2 và cửa 3, J = .   0 1 0 0 0 11 1 0 02 0 1 0 j j S j j              Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 24 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Xét tín hiệu đặt vào cửa 1 và cửa 2 là là và trong khi tín hiệu ra tại các cửa lần lƣợt là , , và . Giả sử √ , √ . Ta cần tính , , và . Hình 3.10 Ta có: [a] = [S].[b] (3.23a) (3.23b) (3.23c) (3.23d) Khi đƣa hai tín hiệu lệch pha vào cửa 1 và cửa 4, tín hiệu tổng sẽ đi ra ở cửa cùng phía với cửa vô có pha chậm hơn (tín hiệu ra ở cửa 3 vì tín hiệu vào cửa 4 có pha chậm hơn). Nếu mạch hybrid có ma trận [S]: Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 25 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Khi đƣa tín hiệu vô cửa 1 thì tín hiệu ra tại cửa 2 và 3 sẽ lệch pha nhau (J = ). (3.24a) √ (3.24b) √ (3.24c) (3.24d) Khi đó, nếu đƣa hai tín hiệu cùng biên độ, lệch pha vô cửa 1 và cửa 4 thì tín hiệu tổng sẽ ra tại cửa 2. √ , √ (3.25a) (3.25b) (3.25c) (3.25d) Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 26 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM CHƢƠNG 4 : THIẾT KẾ MẠCH HYBRID 4.1 Thiết kế mạch hybrid1: Để thiết kế mạch hybrid , ta sử dụng chƣơng trình ADS (Advanced Design System). Dùng LineCalc để tính toán kích thƣớc đƣờng truyền Hình 4.1 Nhƣ vậyở tần số 5.32 GHz, nhánh , dài ( ) có kích thƣớc: w = 1.82 mm, l = 7.5 mm. Nhánh √ , dài ( ) có kích thƣớc: w = 3.12 mm, l = 7.29 mm. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 27 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Sơ đồ mô phỏng : Hình 4.2 Kết quả mô phỏng: Hình 4.3a Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 28 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.3b Nhận xét: - Tại tần số trung tâm: , , , - Nếu chọn và từ trở xuống thì băng thông của mạch từ 5.24 GHz đến 5.4 GHz (khoảng 160 MHz), chiếm 3% tần số trung tâm. Mở rộng băng thông: Mạch hybrid1 có thể đƣợc thiết kế theo dạng mạch ghép hỗn hợp (hybrid) nhƣ trên. Tuy nhiên do điều kiện ràng buộc về chiều dài của mỗi nhánh nên mạch có nhƣợc điểm là băng thông hẹp. Để mở rộng băng thông của mạch, chúng ta có thể sử dụng mô hình mạch ghép hỗn hợp nhiều đoạn. Hình sau giới thiệu một mạch ghép hỗn hợp gồm 2 đoạn (3 nhánh) có điện trở chuẩn . Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 29 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.4 Sơ đồ mạch và kết quả mô phỏng : Hình 4.5 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 30 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.6a Hình 4.6b Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 31 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Nhận xét: - Băng thông của mạch từ 5.09 GHz đến 5.55 GHz (khoảng 460 MHz), chiếm 8.65% tần số trung tâm. Để tăng thêm băng thông, ta có thể ghép thêm nhiều đoạn nhƣ hình 4.7 Hình 4.7 Với Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 32 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Kết quả: Hình 4.8a Hình 4.8b Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 33 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Nhận xét: Băng thông của mạch khá lớn, nằm trong khoảng từ 4.39 GHz đến 6.22 GHz (khoảng 1.83 GHz), chiếm 34.4%. Bằng cách ghép nhiều đoạn, ta có thể tăng băng thông của mạch. Tuy nhiên, sẽ có những khuyết điểm sau: - Kích thƣớc mạch sẽ khá lớn. - Diện tích đƣởng đồng lớn gây suy hao đáng kể cho tín hiệu. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 34 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM 4.2 Giới thiệu phƣơng pháp sử dụng dây chêm trở kháng bƣớc: Mạch hybrid2 là mạch có tính chất tƣơng tự nhƣ mạch hybrid1 nhƣng có thể hoạt động dƣợc ở hai tần số. Giải pháp đầu tiên là tăng băng thông của mạch. Tuy nhiên, nếu hai tần số cần thiết kế cách nhau quá xa (trong trƣờng hợp này là 2.437 GHz và 5.32 GHz) thì điều này không thể thực hiện đƣợc vì: - Kích thƣớc mạch quá lớn, không phù hợp. - Tín hiệu bị suy hao rất nhiều do mạch lớn. - Tính toán rất phức tạp. Chính vì thế, ta cần tìm một dạng mạch khác có thể cho đáp ứng phù hợp ở hai tần số khác nhau. Qua quá trình tìm hiểu, dạng mạch thích hợp là mạch coupler băng tần kép sử dụng dây chêm trở kháng bƣớc (Dual-Band Branch-Line Coupler With Stepped-Impedance-Stub Lines). Phƣơng pháp sử dụng dây chêm trở kháng bƣớc cho ta thiết kế mạch băng tần kép một cách linh hoạt, kích thƣớc mạch nhỏ gọn. Mạch coupler 3dB/ cho ta sự lệch pha và chia đôi công suất ở ngõ ra đƣợc sử dụng rất nhiều trong lĩnh vực siêu cao tần. Dạng mạch truyền thống (hybrid1) chỉ hoạt động đƣợc ở một tần số. Trong các hệ thống thông tin liên lạc hiện đại, ta cần hoạt động ở băng tần kép, băng thông rộng. Để thực hiện điều này, các nhánh cần đƣợc thiết kế lại. Hình 4.9 giới thiệu một đƣờng truyền có dây chêm trở kháng bƣớc bao gồm đƣờng truyền tín hiệu , tại trung tâm là dây chêm , và . Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 35 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.9 Đƣờng truyền dây chêm này sẽ tƣơng đƣơng với nhánh dây có chiều dài . Hình 4.9 thể hiện là trở kháng vào nhìn từ phần và đƣợc tính: (4.1) Ma trận [ABCD] của dƣờng truyền có dây chêm đƣợc tính băng cách nhân ba ma trận [ABCD] của từng phần ghép nối tiếp nhƣ trong hình 4.9 * + [ ] [ ] [ ] Gọi hai tần số hoạt động là và . Ma trận [ABCD] của mạch là: * + 0 1 (4.3) Với J là dẫn nạp đặc tính của đƣờng truyền . Cân bằng mà trận [ABCD] ở 4.2 và 4.3. Ta đƣợc kết quả : Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 36 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM (4.4a) [ ] (4.4b) (4.4c) (4.4d) Với : tỉ số băng tần thứ hai trên băng tần thứ nhất, , và đƣợc tính toán trên . Giá trị của sẽ quyết định khoảng cách của hai tần số. Từ phƣơng trình (4.4a) - (4.4d) ta có thể tính đƣợc và : (4.5a) | | (4.5b) Đối với đƣờng truyền băng tần kép, thƣờng đƣợc chọn trong (4.5) Ta có bốn phƣơng trình (4.4a)-(4.4d) nhƣng có sáu ẩn cần tìm ( ). Do đó tỷ số trở kháng và tỷ số chiều dài đƣờng dây đƣợc chọn làm hai biến tự do trong bộ nghiệm của hệ (4.4). Các nghiệm của hệ này là không duy nhất do có 2 thông số U và R có thể đƣợc chọn. Thay và vào hệ (4.4) và loại bỏ , ta đƣợc một phƣơng trình theo : [ ] [ ] (4.6) Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 37 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Vì R, U và có thể chọn trƣớc theo yêu cầu, nên phƣơng trình trên có thể xem nhƣ phƣơng trình một biến . Với , và , nghiệm của phƣơng trình (4.6) đƣợc thể hiện qua các điểm trên hình 4.10 Hình 4.10 là bốn nghiệm đầu tiên. Đƣơng nhiên là ngắn nhất sẽ đƣợc chọn để tối ƣu kích thƣớc của mạch. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 38 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM 4.3 Thiết kế mạch hybrid2: Hình 4.11 giới thiệu sơ đồ mạch coupler với đƣờng truyền dây chêm trở kháng bƣớc. Kích thƣớc của mạch có thể đƣợc xác định thông qua hệ phƣơng trình (4.4) Hình 4.11 Kích thƣớc của mạch sẽ tối ƣu nhất nếu ta chọn +J trong phƣơng trình (4.4c) và J trong (4.4d) (chọn lệch pha và giữa hai port đầu ra đối với băng tần thứ nhất và thứ hai). Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 39 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.12 phác hoạ và của nhánh đƣờng truyền dây chêm trở kháng bƣớc ứng với giá trị trở kháng là và √ so với R và U tƣơng ứng (băng tần 2.4-/5.8 GHz). Hình 4.12 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 40 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.12 không bao gồm vì có thể tính đƣợc dễ dàng ở (4.5). và tăng đơn điệu khi R tăng. U nhỏ sẽ cho giá trị trở kháng , cao. Thông thƣờng, giá trị trở kháng thƣờng chọn từ do giới hạn của công nghệ vi dải. Do đó khoảng giá trị của R là đối với nhánh , trong khi giá trị U phụ thuộc vào giá trị R đƣợc chọn. Với R = 1, ta có trƣờng hợp điều này là không thực tế. Nhận xét tƣơng tự cho nhánh trở kháng √ , khoảng giá trị của R là . Hình 4.9 mô tả và tƣơng ứng với chiều dài và chiều rộng của đƣờng truyền dây chêm trở kháng bƣớc. Từ phƣơng trình (4.5a) ta thấy chỉ phụ thƣợc vào và không dễ giảm xuống vì không là biến của R và U. Tuy nhiên, có thể giảm kích thƣớc của . Hình 4.13 mô tả nhƣ là một hàm của U và biến R Hình 4.13 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 41 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Với R = 1, . Khi R < 1, luôn nhỏ hơn , chiều dài này giảm là vì sự gia tăng không đều của trở kháng. Các đƣờng cong của rơi nhanh khi R và U giảm và đạt giá trị thấp nhất xung quanh điểm . Nếu giá trị của U quá nhỏ có thể tạo ra các giá trị trở kháng không thực tế, giá trị tối ƣu của R và U phải đƣợc xem xét giữa việc tối thiểu và mức độ thực tế của và . Các đồ thị trong hình 4.12 và 4.13 cho ta thấy và (0.3, 0.2) là phù hợp với nhánh băng tần kép và √ .. Hình 4.14a và 4.14b chỉ ra các giá trị của nhánhbăng tần kép và √ . Hình 4.14a Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 42 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.14b Khi tỷ số đƣợc xác định, ta có thể dễ dàng tìm đƣợc mới quan hệ về kích thƣớc của từ hình 14.4. Hình 4.14 và phƣơng trình (4.5) rất hữu dụng trong việc thiết kế. Nếu quá lớn hoặc quá nhỏ, có thể không thực tế. Do đó, hình 4.14 cung cấp cho ta những sự kết hợp khác nhau của (R, U) để hỗ trợ cho tỷ số trong khoảng 1.7 - 2.7 Hình 4.15 trình bày sự thay đổi của băng thông đối với R và U. Vì trở kháng có thể thực hiện đƣợc trong thực tế là rất quan trọng, do đó chỉ có R = 0.3 - 0.5 và Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 43 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM U = 0.2 - 0.7 là đƣợc xem xét. Các phân đoạn băng thông không thay đổi đáng kể với R và U: 11% - 13% đối với băng tần thứ nhất và 4% - 7% đối với băng tần thứ 2. Hình 4.15 Thiết kế: Băng tần thứ nhất: GHz, Băng tần thứ hai: GHz Từ (4.5) suy ra : Từ hình 4.14 suy ra: Nhánh : (R, U) = (0.4, 0.2) Nhánh 50/√ : (R, U) = (0.4, 0.2) Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 44 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Sơ đồ mô phỏng: Hình 4.16 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 45 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Kết quả mô phỏng: Hình 4.17a Hình 4.17b Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 46 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Nhận xét: - Mạch đáp ứng tốt tại tần số trung tâm. - Băng tần thứ nhất có băng thông khoảng 3%, băng tần thứ hai có băng thông khoảng 2% - Băng thông của mạch khá nhỏ. Để tăng băng thông của mạch, ta có thể ghép nhiều phần mạch nhƣ trong phần 4.1. Hình 4.18 sẽ trình mày mô hình mạch ghép: Hình 4.18a Hình 4.18b Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 47 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.18a trình bày mạch cơ bản, Dựa vào phƣơng pháp phân tích mạch thành mode chẵn và mode lẻ, ta có thể xác định đƣợc trở kháng của các nhánh: √ (4.7a) (4.7b) Với C là hệ số ghép của hai cửa output ( √ ). Giá trị có thể chọn bất kỳ, tuy nhiên nếu chọn sẽ cho băng thông lớn nhất. Từ phƣơng trình (4.7) ta có các kết quả: √ Hình 4.18b giới thiệu sơ đồ mạch khi ta sử dụng phƣơng pháp đƣờng tryền dây chêm trở kháng bƣớc. Nhánh √ có các thông số trở kháng và chiều dài nhƣ phần trƣớc, ta xét nhánh có trở kháng . Bàng 4.1 trình bày các kích thƣớc của nhánh tuỳ theo giá trị của Bảng 4.1 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 48 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Ta có kết quả kích thƣớc của mạch: Từ (4.5) suy ra : Nhánh √ : (R, U) = (0.4, 0.2) Nhánh : (R, U) = (0.2, 0.3) Sơ đồ mô phỏng: Hình 4.19 Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 49 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Kết quả mô phỏng: Hình 4.20a Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 50 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Hình 4.20b Nhận xét: - Tần số đáp ứng của mach là 2.437 GHz và 5.316 GHz. - Băng thông của mạch khoảng 12% đối với băng tần thứ nhất và khoảng 6% đối với băng tần thứ hai. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 51 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM CHƢƠNG 5: THIẾT KẾ MẠCH LỌC Mạch lọc siêu cao tần đƣợc xem nhƣ là một mạng 2 cửa siêu cao tần có đáp ứng tần số thõa mãn các yêu cầu định trƣớc về tần số của tín hiệu: cho phép tín hiệu ở tần số dải thông ( pass-band ) đi qua và không cho phép các tín hiệu ở tần số dải chặn ( stop-band ) đi qua mạng 2 cửa. Các dạng mạch lọc căn bản gồm có: mạch lọc thông thấp ( low-pass ), thông cao ( high-pass ), thông dải ( band-pass ) và chắn dải ( band-stop ). Mạch lọc siêu cao tần đƣợc ứng dụng rộng rãi trong hệ thống thông tin siêu cao tần, trong radar hoặc trong các thiết bị đo lƣờng… Nội dung chƣơng này sẽ trình bày cách thiết cách thiết kế một bộ lọc thông dải sử dụng công nghệ vi dải, và bộ lọc này nhằm phục vụ cho bộ combiner siêu cao tần. 5.1 Cơ sở lý thuyết mạch lọc: 5.1.1 Ma trận S của mạch lọc: a. Công thức tính Mạch lọc là một mạng 2 cửa nên có ma trận tán xạ 2x2 nhƣ sau: [ ] Và có mô hình nhƣ hình dƣới Hình 5.1: Mô hình mạng 2 cửa Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 52 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Trong đó là thành phần sóng tới cửa i là thành phần sóng phản xạ cửa i . √ √ / i=1 và 2 (5.1) . √ √ / Các hệ số tán xạ S đƣợc xác định [b] = [S].[a] * + * + * + b. Ý nghĩa vật lý của các hệ số ma trận [S]: - Ý nghĩa của S11: Điều kiện a2=0 nghĩa là không có sóng đi vào cửa 2 của mạng, cửa 2 đƣợc kết thúc bởi tải phối hợp trở kháng để không có sóng phản xạ trên tải quay ngƣợc vào cửa 2 (5.2) Vậy S11 chính là hệ số phản xạ điện áp tại cửa vào 1 - Ý nghĩa của S22: tƣơng tự nhƣ S11, đây là hệ số phản xạ điện áp tại cửa vào 2. Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 53 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM - Ý nghĩa của S21: S21 là tỉ số sóng ra tại cửa 2 trên sóng vào cửa 1 khi không có sóng tới tại cửa 2. Vậy S21 là hệ số truyền đạt công suất từ cửa 1 đến cửa 2 - Ý nghĩa của S12: tƣơng tự nhƣ S21, là hệ số truyền đạt công suất từ cửa 2 đến cửa 1 5.1.2 Đáp ứng Chebyshev: a. Các định nghĩa và công thức: Hình 5.2: Cấu trúc lowpass prototype filters Các thành phần trở kháng chuẩn hóa của đáp ứng Chebyshev ở hình 5.2 đƣợc cho bởi các công thức sau đây: ( ) Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 54 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM * + * + * + 2 ( ) (5.3) Với * ( )+ (5.4) ( ) (5.5) là độ gợn thông dải tính theo dB (5.6) Với là giá trị S11 tính theo dB Hình 5.3: Đáp ứng lowpass Chebyshev Và các giá trị trong bảng 5.1 dƣới đây đƣợc tính tại Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 55 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Bảng 5.1: Bảng các giá trị thành phần của đáp ứng Chebyshev tại B b. Các tính chất của mạch lọc Chebyshev: Hình 5.4: Phương pháp để chọn một bộ lọc Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 56 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Tùy vào yêu cầu của mạch lọc mà ngƣời ta chọn các đáp ứng mạch lọc khác nhau nhƣ: Butterworth, Chebyshev, Inverse Chebyshev, Elliptic Funtion, Gaussion… Trong đó mạch lọc Chebyshev đáp ứng đƣợc yêu cầu về độ dốc suy hao ngoài dải thông lớn, băng thông rộng Hình 5.5: Đáp ứng độ lợi của bộ lọc lowpass Chebyshev Sự ảnh hƣởng của bậc bộ lọc với đáp ứng của mạch lọc Chebyshev đƣợc thể hiện trong hình 5.5 ở trên, ta thấy bậc của bộ lọc càng cao thì đáp ứng ra càng dốc Luận Văn Tốt Nghiệp GVHD: ThS. Nguyễn Dương Thế Nhân ________________________________________________________________________________ 57 SVTH: Nguyễn Xuân Thọ, Nguyễn Anh Tuấn ĐH Bách Khoa HCM Đồng thời so s